TPS70748

说明
TPS707xx系列器件的设计提供一个完整的电源管理解决方案与TMS320™DSP系列处理器电源，专用集成电路，FPGA中，双输出稳压所需的数字化应用。简易编程的排序功能使得任何TMS320系列DSP的电源排序要求应用的的TPS707xx家庭的理想。差异化的功能，如精度，快速瞬态响应，SVS的监控电路，手动复位输入，使能功能，提供了一个完整的系统解决方案。

稳压器TPS707xx系列提供非常低的压差电压和电顺序控制，这主要是专为DSP应用的双输出。这些器件具有极低的噪声输出性能，而无需使用任何附加的过滤器旁路电容，并设计有一个快速的瞬态响应和10μF的低ESR电容的稳定。

这些设备有固定的3.3V/2.5V，3.3V/1.8V，3.3V/1.5V，3.3V/1.2V，可调/可调电压选项。 1稳压器可以支持高达250mA，稳压器2可以支持高达125mA。独立的电压输入允许设计者配置的源动力。

由于PMOS器件的低电阻值的行为，是非常低的压降（一般为83mV调节1）是成正比的输出电流。此外，由于PMOS旁路元件是电压驱动器件，静态电流非常低，独立输出负载（在全方位的输出电流最大230μA）。该LDO系列产品还采用了睡眠模式，应用高​​信号符合EN（使能）关闭这两个监管机构，减少在TJ = +25°C输入电流降至1μA

EN引脚被连接到一个低级别的输入电压时，该装置已启用。两个稳压器的输出电压遥感在引脚的VSENSE1和VSENSE2，分别。

在SEQ引脚的输入信号控制的两间监管机构的上电顺序。当设备被启用的SEQ终端拉到第一，把VOUT1仍处于关闭状态，直到VOUT2的调节输出电压达到约83％的高或左开，VOUT2的曲折。当时的VOUT1被打开。 VOUT2的，如果低于83％（例如，过载条件下）拉，把VOUT1被关闭。拉SEQ终端低反转的电令的VOUT1先打开。的SEQ引脚连接到一个内部的上拉电流源。

每个稳压器，有一个内部放电晶体管输出电容放电时，稳压器​​关闭（禁用）。

PG1的脚报告的VOUT1的电压条件下，它可以用来实施的SVS电路提供稳压器1。

TPS707xx设有一个RESET（SVS的，POR上电复位）。 RESET输出启动在DSP系统的复位和欠压条件时，相关数字应用。 RESET表示VOUT2的地位和手动复位引脚（MR1及MR2）。当VOUT2的达到95％稳压MR1及MR2在逻辑高状态，RESET变为高阻抗状态，120ms的延迟之后。 RESET变为逻辑低状态时VOUT2的稳压输出电压低于95％（例如，过载条件）稳压拉。要监视的VOUT1，PG1的输出引脚可以连接件MR1或MR2。

该器件具有欠压锁定（UVLO）电路，防止内部监管的转折点上，直到达到2.5V VIN1：。

特性
双路输出电压为分离式电源应用
可选的上电排序DSP应用（参见独立的使能输出的零件编号TPS708xx）
输出电流范围为250mA稳压器2稳压器1和125毫安
快速瞬态响应
电压选项：3.3V/2.5V，3.3V/1.8V，3.3V/1.5V，3.3V/1.2V，可调式双输出
开漏上电复位与120ms的延迟
漏极开路功率良好的稳压器1
超低190μA（典型值）静态电流
1μA的待机时输入电流
低噪音：无旁路电容65μVRMS
快速输出电容放电功能
两个手动复位输入
2％的精度随负载和温度变化
欠压锁定（UVLO）功能
的PowerPAD™20引脚TSSOP封装
热关断保护

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